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LPDDR5、LPDDR4X、LPDDR4、LPDDR3 PHY 和控制器
面向 LPDDR5/4X/4/3 的 Cadence® Denali® PHY 和控制器是一个高速片上存储器接口 IP 系列,产品针对每个应用的需求经过优化,可满足高性能要求。Denali LPDDR 控制器提供了一系列广泛的功能,以满足新兴的 LPDDR DRAM 子系统的 RAS、ECC、奇偶校验和数据擦除功能。针对应用经过优化的 LPDDR5 PHY 和控制器可以实现行业领先的数据速率。低功耗特性包括多个低功耗状态,以延长电池寿命,实现节能操作。
适用于数据密集型应用
业界领先的 PPA,基于先进的架构设计和电路实现
基于先进的时钟设计和 I/O 架构设计,实现最大系统裕度
PHY
Controller
datasheet
Brochure
DDR5/4/LPDDR5/4X PHY IP for TSMC 5nm
配置灵活的高性能多协议 IP
用于高性能多通道内存系统的前沿 IP
用于图形处理、AI/ML 和汽车电子产品的高性能 IP
用于图形、AI/ML 的性能更高的 IP