Key Benefits
- 实时并行工程和分布式设计,支持多个设计人员实时协作处理同一个设计
- 显著缩短布局设计周期
- 可减少80%高速接口布线时间
如果拥有一支遍布全球的设计团队,缩短设计周期将十分困难。通过人工手动操作解决多用户问题,既耗时又低效还容易出错。The Cadence Allegro PCB Designer 为 IC封装设计团队提供了两种协作方式: 利用共享设计实现并行工程设计,以及通过设计分区实现团队的协同设计。这两种方式都可以让多名设计人员协同处理同一设计项目,从而缩短布局周期。
使用共享设计实现并行工程设计
Allegro®PCB Symphony™ Team Design Option的并行设计功能可最大限度缩短布线周期。该方案中的共享设计提供了一种低成本的设计环境,使多名设计人员可以同时在同一设计文件、同一设计界面中进行设计,而无需进行分区设置。参与其中的工程师越多,团队完成设计的速度就越快。
协同设计,支持多个设计者同时参与一个设计
通过将多名设计人员连接到一个公共的 SiP Layout 数据库,他们在自己设计界面中所做的任何更改都将反映在服务器上,同时被其他设计人员看到,从而消除了手动复制/粘贴可能带来的混乱。
简单灵活的设置,易于使用
- 灵活的临时模式,无需繁琐的设置,即可随时让团队成员加入到设计项目中。设计人员可以随时加入或离开,并且所有设计更新都会实时更新至主数据库。
- 网络结构化的实时协同模式:将设计托管在网络服务器上,允许多名设计人员同时访问服务器,开启并行设计服务。支持对设计进行集中管理,无需用户干预。
支持与协作工程师(SI/ MCAD 等)协同设计
例如网表、结构图、设计规则更新等任务会频繁中断PCB设计过程
- Allegro PCB Symphony Team Design Option 的约束编辑功能,支持工程师在进行并行设计任务的同时,客户可以在Constraint Manager 约束管理器中修改编辑约束。
- 在 Allegro PCB Symphony Team Design Option 使用过程中,可使用网表导入和 MCAD 导入功能,而无需让团队成员退出设计。
Allegro PCB Designer的强大功能
在并行设计环境中,PCB设计人员可以借助Allegro PCB Designer的功能加快新产品的推出。
- 设计中的可视化3D功能
- 电源网络的铜皮编辑及修改
- Placement Edit Application 模式
- 支持交互式走线编辑命令、Allegro 自动相位差调整 (AiPT) 和自动等长调整 (AiDT)功能,以及布线过程中的动态避让
- 结合了AiPT和AiDT的TimingVision™环境可将高速PCB接口的计时关闭缩短75%
- 阻抗分析及可视化
- 丝印可用来标识和区别测试点、组件标签、装配说明等
- 设计报告生成及全/窗口 DRC 更新
- 可测性
基于分区设计模式的团队设计
Allegro PCB Design Partitioning Option(可单独购买)实现分块设计,可从主设计中导出单个设计部分,由PCB设计人员单独进行设计。由多个设计团队成员,对导出的设计分区进行布局和编辑,可加快完成设计。每名设计人员都可以查看所有分区设计部分并更新设计,以查看其他用户的设计的状态和进度。
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