Realtek、N12デザインのシリコン提供に向け、ケイデンスのTempus Timing Solutionを採用
01 Nov 2023
要旨
- 従来の設計手法と比較して生産性が最大2倍向上
- 設計期間と設計にかかるCPUおよびメモリのコストを50%削減
ケイデンス・デザイン・システムズ社(本社 米国カリフォルニア州サンノゼ市、以下ケイデンス)は、10月31日(米国時間)、RealtekがCadence® Tempus™ Timing Solutionを採用してN12プロセスの高性能CPUコアのサインオフに成功し、消費電力、性能、面積(PPA)を大幅に改善したことを発表しました。Tempus Timing Solutionを採用することで、Realtek社は生産性を2倍向上させ、設計期間を従来の方法と比較して50%短縮しました。さらに、Realtekは、CPUコストとメモリフットプリントを50%削減しました。
ケイデンスのサインオフ・ソリューションは、以下のの大きな成果をRealtekチームに提供しました:
- 高精度のゴールデン・サインオフ分析: ケイデンスのTempus Timing SolutionとQuantus™ Extraction Solutionにより、Realtekチームはシリコンと相関性の高い設計を実現し、正確に動作するシリコンを確実に提供できるようになりました
- 生産性の向上と設計期間の短縮: RealteckはTempus ECOオプションのSmartMMMC OptimizationとレイアウトツールのInnovus™ Implementation Systemを併用することで、より少ないイタレーションでより速く効率的にタイミングを収束させることが可能になりました
- 演算処理能力の低減: 1回の実行ですべてのサインオフ条件をSTA検証することができるTempusのコンカレントマルチモードマルチコーナー(CMMC)テクノロジーにより、Realtekはマシンリソースを大幅に節約しながら、設計期間を短縮することができました
Realtek社コメント
Yee-Wei Huang氏(vice president)
「私たちのビジネスにとって、最適なパフォーマンスを発揮する機能で市場投入までの期限を厳守することは非常に重要です。ケイデンスとのN12設計プロジェクトが成功し、短期間で実用的なシリコンを完成させることができ、今後、さまざまな技術分野の新規プロジェクトにTempusタイミングソリューションを導入する予定です。」
ケイデンス・コメント
Sharad Mehrotra(vice president, R&D in the Digital & Signoff Group)
「先端ノード設計が複雑化する中、Realtek社のようなお客様が、生産性を向上させ、市場投入の期間を遵守し、最適なPPAを実現するための迅速なソリューションを提供することが重要です。Realtek社と緊密に協業することによ り、当社のタイミング・サインオフ・ソリューション戦略が、同チームのすべての重要な課題を克服することを実証することができました。Realtek社は、サインオフ・ソリューションをご採用いただく企業の一員となり、今後も成功に向けて協力していきたいと考えています。」
Tempus Timing Solutionは、サインオフと設計テープアウトへの高速パスを提供する、ケイデンスのデジタル・フルフローの製品です。Tempus Timing Solutionとデジタル・フルフローは、当社のIntelligent System Design™戦略を支えるものであり、卓越したSoC設計を加速します。Tempus Timing Solutionの詳細については、 www.cadence.com/go/tempusrcs をご参照ください。
ケイデンスについて
ケイデンスは30年以上にわたり蓄積してきた演算処理ソフトウェア(computational software)の専門知識を基盤とする電子システム設計業界のリーダーです。Intelligent System Design戦略のもと、設計コンセプトを実現するためのソフトウェア、ハードウェア、IPを提供しています。ケイデンスのお客様は、世界で最も革新的な企業であり、ハイパースケールコンピューティング、5G通信、自動車、モバイル、航空宇宙、コンシューマー、産業向け、ヘルスケアなど成長市場において開発される様々なアプリケーションに向けて、チップからボード、システムに至るまで、卓越した電子製品を提供しています。フォーチュン誌は9年連続で、ケイデンス社を「働きがいのある会社ベスト100」に選出しています。ケイデンスに関する詳細についてはcadence.comをご参照ください。
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